FPGA ProASICPLUS® basse consommation

La gamme ProASICPLUS de Microsemi combine les avantages des circuits ASIC avec ceux des dispositifs programmables grâce à la technologie Flash non volatile

Image des FPGA basse consommation ProASICPLUS de Microsemi SoCLa gamme ProASICPLUS de FPGA de Microsemi est une famille de FPGA (réseaux de portes programmables par l'utilisateur) Flash de deuxième génération qui offre des performances supérieures à celles de la famille ProASIC. Elle combine les avantages des circuits ASIC avec ceux des dispositifs programmables grâce à la technologie Flash non volatile. Cela permet aux ingénieurs de créer des systèmes à haute densité en utilisant les outils et les flux de conception ASIC ou FPGA existants. De plus, la gamme ProASICPLUS propose un circuit de conditionnement d'horloge unique basé sur deux boucles à verrouillage de phase (PLL) intégrées. Les dispositifs ProASICPLUS combinent les avantages des circuits ASIC et des FPGA, ce qui permet aux ingénieurs de tirer parti de leurs flux et outils de conception ASIC ou FPGA existants. Contrairement aux FPGA basés sur de la mémoire SRAM, quatre niveaux de hiérarchie de routage simplifient le routage, tandis que l'utilisation de la technologie Flash permet à toutes les fonctionnalités d'être opérationnelles à la mise sous tension (LAPU). Aucune PROM de démarrage externe n'est requise pour prendre en charge la programmation du dispositif. Bien que les mécanismes de sécurité intégrés empêchent l'accès aux informations du programme, une reprogrammation peut être effectuée au niveau du système pour prendre en charge les itérations de conceptions futures et les mises à niveau sur le terrain.

Les dispositifs ProASICPLUS offrent des capacités de programmation in-situ. Pour programmer un dispositif, les données de configuration doivent être fournies via une interface JTAG standard à partir d'un microprocesseur, Silicon Sculptor 3 et FlashPro. Pour les applications sans microprocesseur, Silicon Sculptor II est idéal pour les volumes de production, tandis que les programmeurs FlashPro, par leur petite taille et leur facilité de portabilité, sont parfaits pour le prototypage. La gamme ProASICPLUS de FPGA est entièrement prise en charge par l'environnement de développement intégré (IDE) Libero® de Microsemi et le logiciel de développement FPGA Designer de Microsemi. Le logiciel Designer de Microsemi fournit une suite complète d'outils de développement d'arrière-plan pour la mise au point de FPGA, qui comprend un analyseur temporel statique intégré de premier ordre, un système de positionnement et de routage piloté par synchronisation, un éditeur de contraintes, un visualiseur de schémas de listes d'interconnexions de conception et SmartPower, un outil permettant à l'utilisateur d'estimer rapidement la consommation d'énergie d'une conception.

Fonctionnalités
  • Commerce et industrie
    • 75 000 à 1 million de grilles système
    • Mémoire SRAM à deux ports de 27 K à 198 Kbits
    • 66 à 712 E/S utilisateur
  • Technologie Flash reprogrammable
    • Processus CMOS basé sur la technologie Flash 0,22 µm 4 LM
    • Prise en charge du niveau 0 de LAPU
    • Solution monopuce
    • Aucun dispositif de configuration requis
    • Maintien de la conception programmée pendant les cycles de mise sous tension/hors tension
    • Les dispositifs militaires/aérospatiaux fonctionnent sur toute la plage de températures militaires
  • Performances
    • PCI 3,3 V, 32 bits, jusqu'à 50 MHz (33 MHz au-dessus de la température militaire)
    • Deux boucles PLL intégrées
    • Performances du système externe jusqu'à 150 MHz
  • Circuit unique de conditionnement d'horloge
    • PLL avec des capacités de phase flexible, de multiplication/division et de délai
    • Configuration PLL dynamique interne et/ou externe
    • Deux paires différentielles LVPECL pour les entrées d'horloge ou de données
  • Programmation sécurisée
    • La clé de sécurité la plus efficace de l'industrie (FlashLock®)
  • Basse consommation
    • Commutateurs Flash à faible impédance
    • Structure de routage hiérarchique segmentée
    • Petites cellules logiques efficaces et configurables (combinatoires ou séquentielles)
  • Flux de conception standard pour FPGA et ASIC
    • Flexibilité avec choix d'outils frontaux standard
    • Conception efficace grâce à l'optimisation de grille et la synchronisation frontale
  • Prise en charge ISP
    • Programmation in-situ (ISP) via le port JTAG
  • Hiérarchie de routage hautes performances
    • Réseau local et longue distance ultra-rapide
    • Réseau très longue distance à grande vitesse
    • Réseau mondial divisible hautes performances, faible décalage
    • 100 % de routabilité et d'utilisation

ProASICPLUS® Low-Power FPGAs

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Date de publication : 2019-04-29